O que acontece com um erro de bit random no cache em uma CPU Intel?

Eu tenho um sistema com ECC RAM e uma CPU Xeon E3.

A minha compreensão é que os circuitos ECC na RAM detectairá corrupção a pairtir de erros de bits randoms nos chips RAM.

Mas o que acontece com erros de bit randoms dentro da memory airmazenada em uma CPU Intel? por exemplo, o cache e / ou registros?

Não há um orifício de cobertura onde boa memory RAM é airmazenada em cache na CPU, esta RAM em cache é então corrompida, depois usada pela CPU (sem viewificair a RAM ECC)?

Não consigo encontrair nenhuma informação no site da Intel, exceto paira o topo da linha Xeon E7 sobre proteção ECC de cache.

Isso significa que qualquer CPU da Intel abaixo da linha Xeon E7 é vulnerável à corrupção de memory, seja ou não use a RAM ECC?

Tudo o que você escreveu é viewdade, exceto que você não está listndo razões práticas paira a correção ECC. Eu recomendo ler o airtigo abaixo. Agora, na aplicação prática, os sistemas usam a correção de memory paira realmente aumentair o performance porque alguns hairdwaire e softwaire são capazes de detectair inconsistências em dados e solicitair reprocessamento de transactions. Além disso, é altamente improvável que um erro simples de um único bit possa afetair o seu trabalho. Na viewdade, é mais provável que o superaquecimento de qualquer chip eletrônico no seu computador possa fazer com que o isolador permita o salto de um elétron (uma razão pela qual o oviewclocking faz com que os computadores falhem). A correção da memory é muito importante em cálculos em grande escala que não possuam outros meios de correção, como a modelagem do tempo de cálculos científicos. Em qualquer lugair em que os dados corruptos sejam repetidos bilhões de vezes ou onde longos numbers de floating point sejam processados. Por essa razão, até onde eu me lembro, todos os núcleos PADDD da Avairia e do SteamRoller, que podem combinair núcleos individuais paira processair numbers de floating point longos de 256 bits, utilizam ECC na memory da CPU.

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